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[求助] 求论文

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发表于 2022-8-5 17:25:13 | 显示全部楼层 |阅读模式
10资产
A Fractional-N Digital LC-PLL Using Coupled Frequency Doubler With Frequency-Tracking Loop for Wireline Applications
A 224-Gb/s DAC-Based PAM-4 Quarter-Rate Transmitter With 8-Tap FFE in 10-nm FinFET
Wandering Spur Suppression in a 4.9-GHz Fractional-N Frequency Synthesizer
Phase Noise Reduction in LC VCO’s Using an Array of Cross-Coupled Nanoscale MOSFETs and Intelligent Post-Fabrication Selection
An Ultra-Low Jitter, Low-Power, 102-GHz PLL Using a Power-Gating Injection-Locked Frequency Multiplier-Based Phase Detector

最佳答案

发表于 2022-8-5 17:25:14 | 显示全部楼层
Phase_Noise_Reduction_in_LC_VCOs_Using_an_Array_of_Cross-Coupled_Nanoscale_MOSFE.pdf (5.55 MB, 下载次数: 6 ) Wandering_Spur_Suppression_in_a_4.9-GHz_Fractional-N_Frequency_Synthesizer.pdf (6.98 MB, 下载次数: 6 ) An_Ultra-Low_Jitter_Low-Power_102-GHz_PLL_Using_a_Power-Gating_Injection-Locked_.pdf (5.84 MB, 下载次数: 5 ) A_Fractional-N_Digital_LC-PLL_Using_Coupled_Frequency_Doubler_With_Frequency-Tra.pdf (4.91 MB, 下载次数: 5 ) A_224-Gb_s_DAC-Based_PAM-4_Quarter-Rate_Transmitter_With_8-Tap_FFE_in_10-nm_FinFET.pdf (6.78 MB, 下载次数: 5 )
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发表于 7 天前 | 显示全部楼层
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