在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 3581|回复: 15

[求助] LVS时版图生成的网表多一个二极管

[复制链接]
发表于 2022-6-16 13:17:23 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
如图,一个buffer,版图是调取的smic标准单元库里的,为什么版图生成的这个网表多出来了一个二极管呢?LVS出现笑脸了,是不是说明这个二极管无所谓啊?这个二极管也并不在这个电路网络里,它两端直接接了VDD VSS image.png image.png

器件数目不对为什么LVS还可以过呢?

小白一个,很多地方不懂,还请大佬指点。
 楼主| 发表于 2022-6-16 13:19:19 | 显示全部楼层
image.png
 楼主| 发表于 2022-6-16 13:20:09 | 显示全部楼层
image.png
发表于 2022-6-16 13:49:42 | 显示全部楼层
Nwell 寄生的diode吧?
发表于 2022-6-16 13:59:14 | 显示全部楼层
应该是寄生的diode
 楼主| 发表于 2022-6-16 14:35:19 | 显示全部楼层


maomao198477 发表于 2022-6-16 13:49
Nwell 寄生的diode吧?


我自己画的标准单元版图也出现了一个这种寄生的diode,但LVS没报错,请问是不是没什么影响呢?
 楼主| 发表于 2022-6-16 14:37:58 | 显示全部楼层


mengxueyilei 发表于 2022-6-16 13:59
应该是寄生的diode


我自己画的标准单元版图也出现了一个这种寄生的diode,但LVS没报错,请问这样可不可以认为版图是和原理图是一致的呢?
发表于 2022-6-16 14:51:24 | 显示全部楼层
把看看rule吧 不提寄生的diode是不是可以
发表于 2022-6-16 16:58:13 | 显示全部楼层
这是nwell与substrate之间产生的寄生diode,我们一般是在runset中把相关的语句给注释掉的。
发表于 2022-6-16 17:06:16 | 显示全部楼层
可以把rule 里面的  寄生diode这一行的开关  设置一下
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-25 03:41 , Processed in 0.024395 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表