在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 2277|回复: 2

[求助] 求教VCS混合仿真遇到的XMRE问题

[复制链接]
发表于 2022-6-2 10:26:14 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
本人混合环境大致是verilog-top,xdut用spice
参考手册格式定义访问模拟模块中的某个节点,如下图所示,但是报错了

image.png


错误报告如下:
Error-[XMRE] Cross-module reference resolution error
    Error found while trying to resolve cross-module reference
    token 'xIcenter'. Originating module 'host', first module hit 'test'.
    Source info: assign secsi0 = test.xdut.xicenter.xitmblk.tsecsi0;

网上查资料,尝试各种方法。
个人分析猜想:
模拟模块是不是只能打到一层的节点,更深的层次达不到?按照手册的格式top.i1.i2.x1.clk,这里i开头的表示是数字模块的层测,x开头表示模拟模块的层,只有1层。
而我的,xicenter.xitmblk都是xdut模拟块更深的层次

有没有精通的大佬,能解惑一下,该如何打到更深的模拟节点呢?


C58F8D09701F6FDA228E109372DA20D8.png
 楼主| 发表于 2022-7-27 13:53:00 | 显示全部楼层
已解决,路径知认小写,不论模拟网表中,模块名是否为大写
发表于 2022-9-22 20:52:36 | 显示全部楼层


1304284523 发表于 2022-7-27 13:53
已解决,路径知认小写,不论模拟网表中,模块名是否为大写


如果模拟spice中有个信号是d<0>,这时hierarchy怎么写?应该不支持top.i1.i2.x1.d<4>这种写法把?
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-25 05:00 , Processed in 0.018417 second(s), 8 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表