[讨论] TDC

发表于 2021-12-11 18:48:50 | 显示全部楼层 |阅读模式

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目前在做一个TDC加DAC的联仿，但是在做TDC的时候发现STOP信号的反馈延时较长，导致输入和输出时间差不匹配，误差较大，（TDC是一个环形游标延时链）大家有什么建议和解决办法吗？又或者有人做过这方面的吗，仿真参数优化等方面新手请求大佬帮助

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