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[原创] verilog 的function函数 可以返回real类型的数据吗?

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发表于 2021-11-25 20:29:53 | 显示全部楼层 |阅读模式
1资产

reg [45:0] B=46`b69;
function  real factorial;

parameter VOLTAGE_MAX=5;
input [45:0] temp1;


begin   

px=($itor(temp1[20:0]))/(2**21-1)*VOLTAGE_MAX;

end

endfunction

real d= factorial(B);


上面的verilog 为什么 出现real d= factorial(B);函数就吃不到B的值,如果改成wire d= factorial(B);就可以吃到,但返回值却是reg类型的,求解答。

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