cadence ADE 仿真电脑配置

dmi7 · 发表于 2021-11-23 15:27:27

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在跑模拟电路仿真时,Cadence ADE并行APS仿真器调取cpu的线程数有没有限制?

1. 如果没有限制,则(内核)线程多+主频慢的cpu将能发挥最大性能,总体仿真速度将最优;
2. 如果有限制, 则(内核)线程少+主频快的CPU将能发挥最大性能,总体仿真速度将最优.

兄弟们，我在虚拟机跑cadence ade 仿真，1ms（32路矩阵）居然花费了16小时，太慢了，目前配置8核intel，请问 2万以内如何配置能大幅度减少这个时间啊？

买 5950 是不是目前最现实的（amd 兼容问题）？

不打算买工作站之类的，目前的通用性强，普通windows下跑虚拟机，各种互换太方便了，

小白来问

hitzhabc · 发表于 2021-11-23 16:02:34

好像没啥特别好的办法。降低精度换速度。当然，电路规模足够大的时候，多核是有优势的。规模小了没啥用。具体占用多少线程似乎是软件自己配置的，只能限制最大值？好像是。如果还不行，混仿吧，数字逻辑用Verilog建模，这个快得多。

hitzhabc · 发表于 2021-11-23 16:04:11

买PC也没啥可选啊。个人觉得AMD这些年兼容性还好。也没有特别突出的问题。

dmi7 · 发表于 2021-11-23 16:09:05

大哥，日本的逻辑看着是逻辑门，实际里面有竞争冒险，V语言那玩意不能当真

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