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查看: 8501|回复: 16

[求助] spi格式的网表spectre怎么仿真

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发表于 2021-7-26 16:51:15 | 显示全部楼层 |阅读模式
200资产
spi格式的网表spectre怎么仿真??求助求助!!!
1,spi格式网表,是由数字cdl网表综合后得到的管级网表,对应的有stdcell的spi格式库文件
2,有个疑问是,通常spectre生成 的网表里模块的名称开头是小写的 .sbuket **,,但是spi是大写的,这里要怎么处理?
3,有知道的麻烦讲一下步骤,谢谢大神了

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1. subckt重复定义有两个解决方法:(1)给symbol做一个spectre view,这样netlist里面就不会有空的subckt定义;(2)在spectre option里面增加 duplicate_subckt=warning duplicate_subckt=error Specify whether duplicate subcircuit definitions are allowed. When set to warning or ignore, the simulator allows duplicate subcircuit definitions. However, it honors only the last subcirc ...
发表于 2021-7-26 16:51:16 | 显示全部楼层
1. subckt重复定义有两个解决方法:(1)给symbol做一个spectre view,这样netlist里面就不会有空的subckt定义;(2)在spectre option里面增加 duplicate_subckt=warning

duplicate_subckt=error
                          Specify whether duplicate subcircuit definitions are allowed. When set to warning or ignore, the simulator  allows duplicate subcircuit definitions. However, it honors only the last subcircuit definition. Depending on
the value that is set, the simulator displays warning messages for the duplicate subcircuit definitions or does not display any message. When set to error, the simulator does not allow duplicate subcircuit definitions and displays an error message. Possible values are error, ignore and warning.

2. 通常数字综合的spice网表的电源和地是gloabal定义的节点,不会出现在subckt的port上,对应的symbol或许需要去掉电源和地的pin;然后使用global的电源,地。
发表于 2021-7-27 08:20:04 | 显示全部楼层
可以用
include "*.spi"
直接包含spice网表,spectre会直接识别为spice格式,spice格式的网表不区分大小写,因此大写的.SUBCKT也问题。
 楼主| 发表于 2021-7-27 14:01:12 | 显示全部楼层


david_reg 发表于 2021-7-27 08:20
可以用
include "*.spi"
直接包含spice网表,spectre会直接识别为spice格式,spice格式的网表不区分大小写 ...



image.png
1,这个地方 我都include 的了  我在电路中创建了一个空电路symbol进行sim,但是依旧会报错,显示定义重复了,这里该怎么操作才好呢?
image.png
2,这两个错误该怎么避免呢?,,它显示BUFF1B这个cell的端口定义不对,,但实际电路网表和lib都有;
image.png
 楼主| 发表于 2021-7-28 14:23:57 | 显示全部楼层


david_reg 发表于 2021-7-26 16:51
1. subckt重复定义有两个解决方法:(1)给symbol做一个spectre view,这样netlist里面就不会有空的subckt ...


非常感谢您的帮助!另外  还有一个小问题,不知道你有没有遇到过;
就是,我现在已经添加了相关仿真需要的网表和库文件的,但是仿真出现一个错误:
显示stdcell库文件定义的一个“BUFF”cell的端口定义和网表里的不一致;但是实际网表看到的端口数都是没有问题的???
image.png
发表于 2021-7-28 15:15:09 | 显示全部楼层


dengbiao 发表于 2021-7-28 14:23
非常感谢您的帮助!另外  还有一个小问题,不知道你有没有遇到过;
就是,我现在已经添加了相关仿真需要 ...


需要仔细检查cell的port定义和netlist里面对应的instance语句中的node数量是否一样。
发表于 2022-7-7 18:24:14 | 显示全部楼层
请问,具体是怎样仿真的?只是在model那加上网表就可以了吗?其他别的不用处理吗?例如端口顺序什么的
发表于 2022-7-29 14:54:36 | 显示全部楼层


小雨娃子 发表于 2022-7-7 18:24
请问,具体是怎样仿真的?只是在model那加上网表就可以了吗?其他别的不用处理吗?例如端口顺序什么的 ...


目前我们做的是copy对应电路的symbol,改名字为spectre,然后用这个spectre代替原来的电路,在model library处添加对应的spectre 网表,在ciw窗口打开CDF 编辑,导入对应的库名和cell名字,选择spectre,componentName添加对应的cell名称,即可进行后仿真。
发表于 2022-8-18 16:19:38 | 显示全部楼层


突然不想平凡 发表于 2022-7-29 14:54
目前我们做的是copy对应电路的symbol,改名字为spectre,然后用这个spectre代替原来的电路,在model libr ...


多谢!!!

发表于 2023-1-7 15:35:17 | 显示全部楼层


dengbiao 发表于 2021-7-28 14:23
非常感谢您的帮助!另外  还有一个小问题,不知道你有没有遇到过;
就是,我现在已经添加了相关仿真需要 ...


您好,请问这个问题解决了吗,我也一直存在这个问题不知道该如何解决
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