verilogams 仿真问题

IC2019 · 发表于 2021-7-21 09:45:20

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我做verilogAMS仿真，模块的接口都定义了啊？这没连接是什么意思？

amodaman · 发表于 2021-7-21 10:12:26

要看你的仿真的Interface Element是怎么定义的了。AMS说你没定义，那应该就是没定义。

IC2019 · 发表于 2021-7-21 10:21:03

amodaman 发表于 2021-7-21 10:12
要看你的仿真的Interface Element是怎么定义的了。AMS说你没定义，那应该就是没定义。 ...

有定义啊，不就是这样定义的吗？

jake · 发表于 2021-7-21 11:07:14

本帖最后由 jake 于 2021-7-20 22:48 编辑

deleted

IC2019 · 发表于 2021-7-21 11:12:37

有没有解决的办法，急急急

jake · 发表于 2021-7-21 11:54:33

源文件里有没有amscf.scs，没有的话建一个。
第一行必须是注释。

// ****************************************************************
simulator lang=spectre

// global signals
global 0 vdd!

// model deck
include "../ADE/models/spectre/gpdk.scs" section=NN

// ams configuration options
amsd{

// set the connect rule power supply
  ie vsup=1.8

// mix analog and digital
  config inst="top.I0 top.I1 top.I2" use=hdl
  portmap subckt=inv autobus=yes
  config inst=top.I3 use=spice

}

amodaman · 发表于 2021-7-21 14:26:05

IC2019 发表于 2021-7-21 11:12
有没有解决的办法，急急急

很简单，在你的xcelium或者IUS的装载路径里面找到一个库， connectLib, 一般在 $CDS_ROOT/tools/affirma_ams/etc/connect_lib/connectLib 路径下。
把这个库加到你的cds.lib里面。在设置仿真的时候，Setup->Connect Rules/IE Setup...菜单跳出来的表格里面有关于A/D，D/A的电平转换的定义就可以了。比如从A到D，多少电压是高电平，从D到A，高电平进入模拟域的时候翻译成多少电压。就这点内容。只要定义了，AMS仿真就可以跑起来。

IC2019 · 发表于 2021-7-21 16:20:05

amodaman 发表于 2021-7-21 14:26
很简单，在你的xcelium或者IUS的装载路径里面找到一个库， connectLib, 一般在 $CDS_ROOT/tools/affirma ...

非常感谢，问题解决了

hehuachangkai · 发表于 2022-5-15 19:45:39

标记一下

sumiqin · 发表于 2022-7-8 10:51:29

amodaman 发表于 2021-7-21 14:26
很简单，在你的xcelium或者IUS的装载路径里面找到一个库， connectLib, 一般在 $CDS_ROOT/tools/affirma ...

你好，就是想请教一下，我这边重新编译产生了connectLib，也可以打开的时候自动能看到connectlib文件选择了，也在cds.lib中加了connectLib库，在Library Manager中可以看到cell。但是在仿真还是报*E,NOUNIT unable to find a unit named 'connRules_18v_full_fast' in the libraries，对比了其他的别人可以自动插入connetion elements，自己就卡在没法自动插入connet单元。是跟6.1.8-64b有关系吗？

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