求助如何显示模块之间的net连接

-v- · 发表于 2020-12-11 19:56:03

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如图，两个器件之间可以正常显示连接关系的虚线，但画好的两个模块之间的连接关系就显示不出来（每个模块的LVS都过了），求教有办法解决吗

jeffej · 发表于 2020-12-12 10:14:50

解决了么 ?

悄悄的邂逅 · 发表于 2020-12-12 10:26:21

打PIN了吗？

IC椰子 · 发表于 2020-12-16 17:45:41

打上pin就行

龙腾虎印 · 发表于 2020-12-24 16:40:56

做好的模块lanel下打上pin,这样在上一层用XL调用这个模块亏ok了

P_duan · 发表于 2021-1-11 17:58:17

你这里单个模块的LVS验证怎么验证的啊?把对应的电路单独copy出来验证的？求解，我就知道DRC可以单独验证局部的器件，LVS咋弄的？

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