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[求助] 大家做PLL时,相位噪声和jitter都是怎么测出来的?

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发表于 2020-6-30 16:00:18 | 显示全部楼层 |阅读模式

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本帖最后由 摩卡咖啡 于 2020-6-30 16:06 编辑

1.我看到,有人说时将模块组合分别测量,描绘出噪声函数,再通过matlab,计算传输函数等等,最终得到输出的相位噪声。感觉这个好难呀,尤其是计算传输函数。这个是普遍方法吗?相位噪声不能通过仿真整个PLL测出来??比如仿真整体tran,然后做fft,看某些位置得出来? image.png

2.jitter的测量
这个能不能也通过整体的tran,利用scope等软件自带的jitter测出来?

image.png
 楼主| 发表于 2020-6-30 16:05:59 | 显示全部楼层
还望大佬指点一下,电路功能有了,但是实在不知道如何判断能不能行。对理论架构也没吃透,要是不行,想着再深入一下,重点解决一下,现在都不知道还要调哪里了
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发表于 2020-6-30 16:33:05 | 显示全部楼层
应该是可以的。而且组合/整体仿真两种方法得到的jitter数值应该是比较接近的。
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 楼主| 发表于 2020-6-30 19:15:10 | 显示全部楼层


   
nanke 发表于 2020-6-30 16:33
应该是可以的。而且组合/整体仿真两种方法得到的jitter数值应该是比较接近的。 ...


多谢指点,那组合仿真主要是为了减少仿真时间吗?
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发表于 2020-6-30 19:30:58 | 显示全部楼层
以cadence平台为例,整体仿真PLL环路,pss是不能收敛的,所以不能直接仿真环路的输出时钟的相噪,只能通过把各个部分的电路的噪声通过传函计算出来相加得到整体的相噪。
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 楼主| 发表于 2020-6-30 20:00:24 | 显示全部楼层


   
磐磬 发表于 2020-6-30 19:30
以cadence平台为例,整体仿真PLL环路,pss是不能收敛的,所以不能直接仿真环路的输出时钟的相噪,只能通过 ...


是这样啊,受教了。整体仿真我是用Hspice做的,要是跑出整体电路的tran,做FTT也可以分析相位噪声吗?
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发表于 2020-6-30 20:08:37 | 显示全部楼层


   
摩卡咖啡 发表于 2020-6-30 20:00
是这样啊,受教了。整体仿真我是用Hspice做的,要是跑出整体电路的tran,做FTT也可以分析相位噪声吗?
...


应该是不能这样的
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发表于 2020-6-30 20:12:40 | 显示全部楼层


   
磐磬 发表于 2020-6-30 20:08
应该是不能这样的


我在cadence平台试验过用transient仿真计算jitter,仿出来和pss+pnoise出来的结果完全不一样。
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 楼主| 发表于 2020-6-30 20:45:27 | 显示全部楼层


   
磐磬 发表于 2020-6-30 20:12
我在cadence平台试验过用transient仿真计算jitter,仿出来和pss+pnoise出来的结果完全不一样。
...


啊,那这样的话,您能否指点一下,去哪可以找到您的这种仿真jitter和phase noise的方法?
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发表于 2020-6-30 21:01:47 | 显示全部楼层


   
摩卡咖啡 发表于 2020-6-30 20:45
啊,那这样的话,您能否指点一下,去哪可以找到您的这种仿真jitter和phase noise的方法? ...


就是用传函分析每个部分的噪声
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