DT DSM ADC OPAMP的带宽/摆率/噪声怎么均衡

ericking0 · 发表于 2018-4-3 22:28:52

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现在做一个二阶DT DSM ADC，单BIT量化，采样率2M，OSR打算128，精度16bit，满幅5V，调制深度0.75左右；

打算省事两阶用相同的运放，运放指标自己随便拆的ClassAB，10M GBW，等效输入noise打算放在200u；

一切都和算起来差不多，但是带入ADC仿真发现摆率不够，一下就很纠结：

如果不烧电，只好降Cc，升带宽，补偿好说，但噪声积分带宽变宽了，DT又是先采样后积分，噪声积分带宽增加直接导致最终噪声增加；

如哦不想升带宽，那么只好减W/L，降gm/Id，降输入对gm，还是增加噪声，而且感觉从系数来看还要亏点；

回过头来还是要烧电；

请问各位有啥办法合适的没啥开销的摆率增强的办法没？

ericking0 · 发表于 2018-4-4 15:21:13

找到解决方案了
关键词：slew rate boosting
虽然会增加动态功耗，但是起码不增加静态功耗；

popfly51 · 发表于 2018-4-4 15:53:31

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i0977454522 · 发表于 2021-10-1 15:21:01

THANK

cys114514 · 发表于 2023-12-6 11:21:17

您好，我想咨询一下这里的调制深度0.75是什么意思

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