VCS编译XILINX的IP库：Error-[URMI] Unresolved modules

DerekYeung · 发表于 2017-8-25 17:25:52

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大家好！

Vivado调用VCS仿真的时候出现许多类似的Error，麻烦大家帮忙看看。

Error-[URMI] Unresolved modules
./../../../mig_7series_0_ex.srcs/sources_1/ip/mig_7series_0/mig_7series_0/user_design/rtl/clocking/mig_7series_v4_0_iodelay_ctrl.v, 282
" BUFG clk_ref_300_400_en.clk_ref_400.u_bufg_clk_ref_400( .O (clk_ref[1]), .I (clk_ref_mmcm_400));"
Module definition of above instance is not found in the design.

类似这种的错误还有很多，这里就不列出来了，详细的在

elaborate.txt (27.78 KB, 下载次数: 49 )

Vivado version：2016.4
VCS version：vcs-mx_vL_2016.03

上网搜过，好像是能通过编译选项开关解决，可是具体的操作不是太清楚

谢谢！

JacksonEEA · 发表于 2021-2-22 11:14:43

这个你需要检查tb文件里例化的模块名和DUT中的模块名是否一致

拾西 · 发表于 2021-12-4 15:28:14

谢谢分享

junnit · 发表于 2021-12-12 13:17:51

请问同行，这个问题解决了么？

mcm908911 · 发表于 2023-1-12 14:31:54

同样遇到了，是因为这个文件里面有些module找不到，说明rtl.f吃的有问题。让你的设计看一下是不是有文件漏吃了。

北极的星辰 · 发表于 2023-4-27 16:48:18

只是列出问题，而不是解决问题。。。

北极的星辰 · 发表于 2023-4-27 17:24:18

有可能是RTL出现问题，可以好好检查一下

BellaYang · 发表于 2024-4-23 17:52:59

mcm908911 发表于 2023-1-12 14:31
同样遇到了，是因为这个文件里面有些module找不到，说明rtl.f吃的有问题。让你的设计看一下是不是有文件漏 ...

没错没错，同样的问题，就是.v文件不全导致的，现在全部加到filelist.f文件里就好了

[求助] VCS编译XILINX的IP库：Error-[URMI] Unresolved modules

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