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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › 关于VerilogA语法的中文资料
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楼主: 维也纳的edg

[求助] 关于VerilogA语法的中文资料

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cdting
发表于 2018-10-31 08:33:22 | 显示全部楼层
非常感謝~~~
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kebowen
发表于 2018-11-13 15:43:31 | 显示全部楼层
thx for share !!!!
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twfly
发表于 2018-11-26 10:11:07 | 显示全部楼层
学习学习，谢谢楼主~
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novel_qin
发表于 2018-11-26 13:49:40 | 显示全部楼层
2楼的资料不错，详细分享！
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一起走2419
发表于 2019-3-20 13:58:12 | 显示全部楼层
谢谢
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savvy_jiang
发表于 2019-3-20 18:00:48 | 显示全部楼层
中文版的完全不是veriloga的语法内容而是一篇中文paper
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星辰0000
发表于 2019-5-24 16:21:33 | 显示全部楼层
中文的吗？
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cdting
发表于 2019-5-30 13:31:02 | 显示全部楼层
非常感謝！！！！！
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lynker
发表于 2019-6-11 16:48:19 | 显示全部楼层
谢谢！
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compass_shtu
发表于 2019-6-21 15:33:08 | 显示全部楼层
Thanks!
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