IEEE Standard for SystemVerilog, IEEE Std 1800™-2012

英特耐雄纳尔 · 发表于 2016-12-12 15:35:44

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本帖最后由英特耐雄纳尔于 2016-12-12 15:40 编辑

IEEE Standard for Systemverilog—Unified Hardware Design, Specification, and Verification Language

IEEE Std 1800™-2012
(Revision of
IEEE Std 1800-2009)

IEEE Standard for SystemVerilog.pdf (6.66 MB, 下载次数: 159 )

apteye · 发表于 2016-12-12 16:48:11

thanks.goodbook

beiyangqing · 发表于 2016-12-13 00:26:59

下来学习了

hyperion007 · 发表于 2016-12-13 16:38:43

下来学习了

auspiciouschen · 发表于 2016-12-16 11:58:33

devotee123 · 发表于 2017-1-1 08:49:02

Xeixei

有缘于你 · 发表于 2017-2-17 23:57:48

谢谢分享

worik · 发表于 2017-3-3 21:14:31

good book

dubo396 · 发表于 2018-1-1 23:57:16

感谢分享。

xiaoyisimonguo · 发表于 2018-1-2 15:47:17

回复 1# 英特耐雄纳尔

thank you for sharing

[资料] IEEE Standard for SystemVerilog, IEEE Std 1800™-2012

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