[高手请进] 802.3 1000basex PCS设计问题咨询

zhyy0201 · 发表于 2016-10-4 18:48:19

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各位高手，请教一个问题，802.3 clause-36 1000base-x PCS设计，为什么需要在接收数据解码后加入一个clock compensation逻辑，理论上，发送时钟和接收时钟都是125M，即使有相位偏移，但收发速率是一样的，不存在数据丢失问题啊。
有谁知道这个时钟补偿逻辑的实现原理吗？

急求，非常感谢！

zhyy0201 · 发表于 2016-10-5 21:23:18

求大神！

zhyy0201 · 发表于 2016-10-6 21:23:42

继续求大神！

wanghaonan311 · 发表于 2017-1-5 18:35:22

这个是因为发送和接收的两个SerDes之间允许有±100ppm的频偏存在，接收端通过CDR恢复时钟来接收数据，所以RX的时钟其实跟本地时钟是有微小的偏差的，为了弥补这个偏差，通常在PCS里做个elastic buffer，也就是个FIFO来纠正。

zhangbinsniper · 发表于 2018-8-11 21:50:27

非同源时钟会存在ppm差的，所以需要补偿

Andy126 · 发表于 2018-12-23 17:03:13

edwardk · 发表于 2018-12-24 10:01:11

学习中。。。。

zhanweisu33 · 发表于 2019-3-27 14:47:22

有没有dnow一个opencores的ip来看看

Tony0229 · 发表于 2023-11-28 10:57:03

厉害了

buaawh · 发表于 2023-12-6 23:21:33

good！学习了

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