在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 2722|回复: 3

[求助] 《SystemVerilog验证 测试平台编写指南.pdf》例8.37求助

[复制链接]
发表于 2016-9-27 13:14:52 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
systemverilog验证例8.37解析.png
这里为啥不是直接gen2drv.put(blueprint)?而还要整一个tr出来?
 楼主| 发表于 2016-9-27 13:24:05 | 显示全部楼层
是为了拷贝一份blueprint,以免下次randomize执行时上一次的还没有发完?所以拷贝一份,以免数据发生变化?
 楼主| 发表于 2016-9-27 13:37:58 | 显示全部楼层
如果不copy:
     blueprint
   /       |       \
tr1       tr2     tr3....
所有的tr指向同一个blueprint
如果copy:
blueprint1 blueprint2 blueprint3...
      |                 |               |
     tr1              tr2            tr3...
tr会指向不同的blueprint。
发表于 2020-1-23 21:19:42 | 显示全部楼层
谢谢楼主
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

×

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-22 07:19 , Processed in 0.016453 second(s), 8 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表