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楼主: sunshining214

[求助] 如何提高cadence的spectre仿真速度?

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发表于 2016-5-6 10:36:39 | 显示全部楼层
回复 9# sunshining214


  不太了解混合信号仿真的情形;  我们做纯模拟仿真时,现在电路规模较大的仿真很少用spectre,基本上是用APS;
  同样是单核跑仿真,APS速度是spectre的3倍左右;
  听说混合信号可以用AMS跑,不妨试试?
发表于 2016-5-6 10:36:42 | 显示全部楼层
回复 9# sunshining214


  不太了解混合信号仿真的情形;  我们做纯模拟仿真时,现在电路规模较大的仿真很少用spectre,基本上是用APS;
  同样是单核跑仿真,APS速度是spectre的3倍左右;
  听说混合信号可以用AMS跑,不妨试试?
发表于 2016-5-6 10:40:15 | 显示全部楼层
回复 9# sunshining214


   另外,之前曾经跑混合仿真用过ultrasimverilog,可以设置仿真精度,精度低的时候仿真速度也快很多,适合于功能仿真,性能不能保证;
发表于 2016-5-6 10:46:53 | 显示全部楼层
回复 1# sunshining214

请问楼主,使用APS时在userCmdLineOption当中是填入++aps还是+aps ?
发表于 2016-5-6 10:48:42 | 显示全部楼层
回复 12# ouyang00032

请问使用APS仿真时在userCmdLineOption当中是填入++aps还是+aps ?
发表于 2016-5-6 11:27:40 | 显示全部楼层
回复 15# 690827881


   我不是在environment里面设置的,而是high performance simulation里面设置;
 楼主| 发表于 2016-5-6 14:14:48 | 显示全部楼层



谢谢,ouyang00032,我没试过你所说的仿真器跑数模混仿,我可以试试看!另外,用APS仿真器,它的精度会比spectre略低
 楼主| 发表于 2016-5-6 16:14:01 | 显示全部楼层
经过比较,我发现UltraSIMVerilog的速度至少是spectreVerilog的两倍 ,即使将SV中的trn精度设成liberal。但在使用USV的时候时候,记得在ADE->Simulation->Options中将Simulation Mode改成Analog(A),或者选择(MS),此时精度则需要设置为(2)。如果不是这么设置的话,仿真将会出错!另外,在使用的时候还有一个发现,在trn的option中可以将integration method parameters下的method 改为trap以提升速度。
发表于 2016-5-6 17:12:58 | 显示全部楼层
回复 16# ouyang00032

谢谢!!!
发表于 2016-5-30 23:40:21 | 显示全部楼层
UltraSim是好东西,不过楼主不要忘记设置仿真精度,还可以设置每隔百分之几显示仿真剩余时长。
建议UltraSim仿真时候,电路中不要设置输出,这样,等仿真结束可以看全部的输出。否则只有保存的输出可以看
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