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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 资源共享 › EDA资源使用讨论 › SPYGLASS ClockGatingOptimizationatRTL
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楼主: ladeng777

SPYGLASS ClockGatingOptimizationatRTL

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risccpu
发表于 2018-12-20 16:56:42 | 显示全部楼层
good clock gating reference.
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tpungi
发表于 2018-12-26 23:02:08 | 显示全部楼层
Thanks for sharing
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tpungi
发表于 2018-12-27 20:26:28 | 显示全部楼层
Thanks for sharing
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texask
发表于 2019-3-30 17:30:40 | 显示全部楼层
谢谢你的分享
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爱吃马的草
发表于 2020-2-10 16:40:14 | 显示全部楼层
非常感谢楼主的分享！
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marx67
发表于 2020-2-11 12:05:32 | 显示全部楼层
谢谢分享！
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smh
发表于 2020-2-27 17:37:58 | 显示全部楼层
thankss
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smh
发表于 2020-2-27 17:39:51 | 显示全部楼层
thankss
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acd09154
发表于 2020-4-22 15:55:51 | 显示全部楼层

谢谢分享
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jfeta
发表于 2021-1-28 13:17:27 | 显示全部楼层
thanks for sharing
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