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重磅消息:最近写了ahb的master,有些问题想和大神们讨论一下!

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发表于 2014-12-14 22:08:54 | 显示全部楼层 |阅读模式

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本帖最后由 redleaf1988 于 2014-12-14 22:13 编辑

本人在,哈工大深圳研究生学院读研,毕业设计在做ahb,现在工作是分模块写代码,最近写了ahb的master,从机还没写,有些问题想和大神们讨论一下!
1  先传一下,我写的verilog代码,modelsim波形仿真图:
   (1)hburst,INCR(未指定长度的增量猝发,每次传输一个字)
   hburst,INCR(未指定长度的增量猝发,每次传输一个字).jpg

    (2)hburst,INCR16(指定长度的16拍增量猝发,每次传输一个字)
   hburst,INCR16(16拍增量猝发,每次传输一字).jpg
    (3)hburst,INCR8(指定长度的8拍增量猝发,每次传输一个字)
   hburst,INCR8(8拍增量猝发,每次传输一字).jpg
    (4)hburst,INCR4(指定长度的4拍增量猝发,每次传输一个字)
   hburst,INCR4(4拍增量猝发,每次传输一字).jpg

     现在我只完成了主机中,未指定长度,16拍,8拍,4拍的增量猝发 写传输,slave和arbiter模块我还没有写,modelsim的仿真波形,激励是自己假定的;

2   遇到的问题:
   (1)总线请求信号 hbusreq信号何时拉低?我用状态机实现的,当向最后一个地址时拉低hbusreq,如上图(4),向起始地址是40,连续增量猝发,写4拍,每拍穿一个字,地址加4,最后一个字的地址时52,在52地址(此时是写最后一个字),上升沿来时拉低hbusreq,这样合理不?如果不合理,应该在哪个地址中拉低hbusreq?

   (2)关于协议中规定的hlock信号,hlock信号解释:信号为高时表示主机请求锁定对总线的访问,并且在该信号为低之前其他主机不应该被允许授予总线。现在 我还不知道什么时候拉高hlock信号,何时拉低hlock信号。该信号是否和hbusreq信号时序一致?


   (3)上述的写传输,我是用状态机实现的,自己定义了读写请求信号,u_wrrd_req信号,作为状态机的控制信号,只能实现向一个起始地址进行一次增量类型猝发传输(如只能实现一次INCR4,或者INCR8,或者INCR16或者未指定长度的INCR),
      还不能实现向一个起始地址进行两次不同的增量猝发传输,如向地址40,先进行一次INCR4,当INCR4进行完之后,再进行INCR8,再进行INCR。
      也不能实现向一个地址x1的猝发传输之后,再接着向地址x2的猝发传输。即如下图所示的传输

    addr1和addr2.png



我研究生毕设做ahb,最近实在很着急,有些东西,写的不是很规范:
一,请做过AHB的大神们,帮我看看,我现在写的代码,仿真波形,有哪些信号的时序不对,求诚恳指点,指点迷津。
二,遇到的问题(1)(2)(3),自己实在解决不了,求高手点点思路,怎么合理的实现出来?
发表于 2014-12-16 14:26:06 | 显示全部楼层
哈工大还是专业整核潜艇去吧,玩其它的简直...
 楼主| 发表于 2014-12-16 20:29:47 | 显示全部楼层
回复 2# kaikai_2014


   上面的问题已经明确 解决完
发表于 2015-3-20 17:27:20 | 显示全部楼层
谁说哈工大是整核潜艇的?
发表于 2015-4-14 10:11:41 | 显示全部楼层
这个问题问得好
发表于 2019-5-16 17:21:14 | 显示全部楼层
有代码吗?
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