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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证讨论 › asic FPGA 验证--系统时钟能跑多高？
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查看: 1317|回复: 1

[求助] asic FPGA 验证--系统时钟能跑多高？

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wdooy
发表于 2014-9-10 17:14:06 | 显示全部楼层 |阅读模式

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现在用K7系列做ASIC 验证，系统时钟约束能做到多高，有什么要求？
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courageheart
发表于 2014-9-10 17:28:46 | 显示全部楼层
添加时序约束，自己预估几个时钟，然后一个个验证呀，看是否有时序违规
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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