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本帖最后由 tsinghuaman2010 于 2013-5-5 08:03 编辑
内部员工内推,tsinghuaman2010@163.com,
ASIC VERIFICATION:
1. 要求985高校,硕士三年以上,本科5年以上ASIC verifcation/design 经历。
2. 精通veilog hdl 语言
3. 熟悉VCS, NCSIM, Verdi 等常用工具
4.了解C,perl tcl等语言
5. 熟悉UVM/OVM 平台
PHYSICAL DESIGN
主要要有ASIC 3年以上经验,有timing closure经验,ECO 等等
大家可以联系我把公司详细JD发给你们
地点在上海
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