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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › 关于layout中lvs验证的问题 [已解决]
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楼主: tianshuai2012

[求助] 关于layout中lvs验证的问题 [已解决]

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tianshuai2012
 楼主| 发表于 2012-4-25 14:34:43 | 显示全部楼层
回复 10# Pokhara


    有什么好的建议吗
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half_honey
发表于 2012-4-25 14:37:56 | 显示全部楼层
试试3楼的建议吧

还真没遇到过这种
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tianshuai2012
 楼主| 发表于 2012-4-25 14:39:28 | 显示全部楼层
回复 12# half_honey


    好的，谢谢了
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motofatfat
发表于 2012-4-25 17:27:46 | 显示全部楼层
應該是 少了 用來 辨識 3 極管 的 dummy layer
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tianshuai2012
 楼主| 发表于 2012-4-25 17:35:11 | 显示全部楼层
回复 14# motofatfat


    好的，我看看
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qunimei
发表于 2018-1-5 16:07:23 | 显示全部楼层
那如果是只是做dummy的认不出来呢？
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Andy126
发表于 2018-12-17 18:35:50 | 显示全部楼层
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