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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)
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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

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tj121
发表于 2020-5-26 00:15:28 | 显示全部楼层
谢谢
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dkboy_123
发表于 2020-6-9 10:32:27 | 显示全部楼层
感谢楼主，好人一生平安
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dkboy_123
发表于 2020-6-9 11:18:16 | 显示全部楼层
怎么有三个文件夹？应该用哪个？楼主能写个中文的readme吗
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uestc_zyd
发表于 2020-8-19 11:22:01 | 显示全部楼层
哥，这个是不会高亮uvm语法的。uvm！=sv的，
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bubulq
发表于 2020-8-20 14:00:07 | 显示全部楼层
感谢分享。
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小羊肖恩
发表于 2020-10-28 09:13:21 | 显示全部楼层
谢谢楼主！
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crueler
发表于 2020-11-10 10:07:32 | 显示全部楼层
感谢楼主啊
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yoyo1234
发表于 2020-11-12 15:45:14 | 显示全部楼层
谢谢
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shenxu1204
发表于 2020-11-14 16:30:03 | 显示全部楼层
谢谢分享，这个很好用哦
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steven_sun
发表于 2020-12-17 21:06:00 来自手机 | 显示全部楼层
感谢
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