Synopsys 公司招聘Senior IC Complier工程师

edatraining · 发表于 2010-6-17 18:50:55

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本帖最后由 edatraining 于 2010-6-17 19:01 编辑

Requisition Description:
The Candidate will be responsible for physical hierarchy flow's development and comprehensive advanced feature testing of Synopsys IC Compiler. Good knowledge of high-level hierarchy design methodologies, Include hierarchy mcmm flow,Hierarchy UPF low power flow.And the candidate should be able to develop tools/scripts to constantly improve testing process efficiency and product quality.

BS with 5+ years of relevant experience , MS with 3+ years of relevant experience, or related Ph.D with 1+ years of experience.
Strong communication. Proficient Physical Hierarchy design methodology or a strong understanding of ASIC design flows . Knowledge of cimpetitive EDA tool products and product knowledge in the areas of place and route,Design Reuse and/or Physical Design is highly desired.

If you are interested in it, Please email you resumes to aspc1234@yahoo.com.cn

Synopsys是世界第一的EDA软件公司主要面的客户是一流的ASIC design 公司（Intel,ST,LSI,Toshiba....) 特别是超大规模的数字前端/后端设计.
新一代的后端EDA 软件 IC complier 已经可以支持32nm 下的后端设计。同时最大的Tapeout 达到4000万个 Cell instance.（~1.6亿个gate), Physical Hierarchy design 占据着越来越重要的角色

edatraining · 发表于 2010-6-17 19:04:13

同时还有少量Intern 职位有上海学校的研二的学生较好的program/script 能力
也可以send your resume to aspc1234@yahoo.com.cn

alisonxx · 发表于 2010-6-19 21:30:28

提示: 作者被禁止或删除内容自动屏蔽

edatraining · 发表于 2010-6-21 18:04:37

本帖最后由 edatraining 于 2010-6-22 15:47 编辑

工作地点在上海，中山公园

edatraining · 发表于 2010-7-23 16:39:10

自己顶。。。待遇优厚要来得快

alisonxx alisonxx 当前离线积分 505 头像被屏蔽	发表于 2010-6-19 21:30:28 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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