流水线ADC MDAC建立疑问

malesky · 发表于 2010-5-19 17:17:44

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流水线ADC前端采样保持信号比较理想，我将前端用到的运放直接用于后级1.5位每级MDAC，但是发现MDAC保持信号有缓慢上升的问题，不知道原因？求助

sswong · 发表于 2010-5-19 20:46:28

那可能是你的OPAMP可能驅動的電容值過大, 導致MDAC SETTLING 很慢.....

malesky · 发表于 2010-5-19 21:09:19

2# sswong

我的SH电路采样保持电容3pf，负载电容3pf，采样保持电路工作正常，MDAC电路采样电容1.5pf，负载3pf，MDAC实现两倍增益，但是MDAC会出现保持信号缓慢上升到问题，上述电容设置应该不会有问题吧

analog123 · 发表于 2010-5-19 21:15:31

应该不是这个问题，看看时序是否正常

malesky · 发表于 2010-5-20 09:12:38

4# analog123 但但是我的不交叠时钟工作正常。不知道原因

tayo134 · 发表于 2010-5-20 10:54:21

表述不清，没法评论（可能正常，也可能不正常）
最好有较详细的数据和波形图

malesky · 发表于 2010-5-20 11:46:33

6# tayo134
MDAC、SH电路，以及不交叠时钟仿真波形见附件

SH and MDAC.rar (360.56 KB, 下载次数: 130 )

malesky · 发表于 2010-5-20 11:57:26

6# tayo134
MDAC、SH电路，以及不交叠时钟仿真波形见附件

2222silicon · 发表于 2010-5-20 12:04:04

上电路，光看仿真结果怎么看得出来？

tayo134 · 发表于 2010-5-20 13:22:00

6# tayo134
MDAC、SH电路，以及不交叠时钟仿真波形见附件278299
malesky 发表于 2010-5-20 11:46

登录/注册后可看大图

从波形图上看，好像是还没有建立好。但是从你放大的那张图上又看不出来没有建立好，你可以把它放大看一看，是否是在要求范围内的。不知道你是多少位的ADC，如果8~9位的话，应该是没有什么问题了，住上可能会有精度问题。

再说一说个人观点。
其实仿真建立只需要对最大的Vpp和最大的信号频率进行仿真即可，就是说输入信号为+-Vpp/2的一个放波，频率为fs/2，在稳定以后直接看建立，不用做FFT。
关于输入信号采样，可以对这个情况单独仿真（主要有建立+带宽+FFT）。如果你的运放增益没有问题，那么在做整体仿真时性能应该不会出问题。
还有就是做SH和MDAC的时候有带上后面电路的实际情况吧

[求助] 流水线ADC MDAC建立疑问

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