【原创＝心得笔记】FPGA Pipeline RISC设计（2）

brucezhan · 发表于 2009-2-26 13:01:37

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简单RISC cpu设计日记
三级流水到五级流水描述
针对FPGA优化实现
设计过程记录
详细优化思路描述
以图示说明为主

Pipeline RISC 设计2.pdf (766.09 KB, 下载次数: 406 )

[ 本帖最后由 brucezhan 于 2009-2-26 19:03 编辑 ]

allen8198 · 发表于 2009-3-1 11:38:35

thanks~~~

haershiwo · 发表于 2009-4-27 21:59:15

谢谢了！！！

sea19150734 · 发表于 2009-5-23 19:38:48

thank for share

smcf62 · 发表于 2009-5-26 21:44:49

下来看看

snakkewang · 发表于 2009-7-1 21:31:31

97asfdfasdfsdfsfsdfa

liuhong198428 · 发表于 2009-7-5 20:04:48

hao hao hao hao hao hao hao hao hao hao

tongbenhua · 发表于 2009-7-7 13:34:50

下下来看看！

linjunespn · 发表于 2009-7-8 00:51:23

谢谢分享

demonyh · 发表于 2009-7-8 07:01:49

thanks for sharing

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