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楼主: wfcawy

如何对 pll 进行系统仿真 ?

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发表于 2010-8-4 22:10:01 | 显示全部楼层


完全行为级:matlab/simulink

部分行为级+部分(门)管级:verilogA+verilog+composer        仿真器:spectre+nclaunch

完全(门)管级: verilog+composer     仿真器:spectre+nclaunch
xingxp1983 发表于 2008-10-20 03:51


这个回帖Mark一下
发表于 2010-8-22 20:56:32 | 显示全部楼层
完全行为级:matlab/simulink

部分行为级+部分(门)管级:verilogA+verilog+composer        仿真器:spectre+nclaunch

完全(门)管级: verilog+composer     仿真器:spectre+nclaunch
发表于 2010-8-25 09:35:10 | 显示全部楼层
1.  behavior  Matlab Simulink  
  maybe someone use saber

建立 vco 還有 k 值
設 low pass filter
還有 freq divide

再來應該是算 lock range  , lock freq ..

2. sim behavior

3. 確定 vco  ..都ok
把behavior 化成 spice 電路
发表于 2010-10-8 22:23:00 | 显示全部楼层
回复 34# peterlin2010


    thxxxxxxxxxxxx
发表于 2010-10-9 09:04:35 | 显示全部楼层
回复 7# xingxp1983
thxxxxxxxxxxxx.
发表于 2010-10-9 14:09:44 | 显示全部楼层
回复 2# lownbin


    thxxxxxxxxxxxxxxxx
发表于 2010-10-9 16:42:32 | 显示全部楼层
Candence最新的设计流程中已经可以这样做了.
发表于 2010-10-9 16:45:25 | 显示全部楼层
在设计公司专门由前端工程师设计,如果用快速仿真器全晶体管仿真1天,只行为级1小时
发表于 2010-10-22 16:36:27 | 显示全部楼层
谢谢楼主分享!
发表于 2010-12-1 11:14:48 | 显示全部楼层
回复 15# goodlvjie2001


  matlab
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