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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › 关于systemverilog的2个文本
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楼主: wangsheng0415

关于systemverilog的2个文本

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siler_cn
发表于 2008-7-11 00:01:21 | 显示全部楼层

ic新人

能整成一个附件吗，下两次还得扣两次钱
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chyyang
发表于 2008-7-15 10:29:11 | 显示全部楼层
有点不厚道
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chyyang
发表于 2008-7-15 10:30:50 | 显示全部楼层
没money,再回一次
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yrr66323
发表于 2008-7-24 14:19:46 | 显示全部楼层
dingdingdingding
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ilxsh
发表于 2008-8-1 01:28:19 | 显示全部楼层
我需要money下载第一本书
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osric
发表于 2008-8-3 21:00:27 | 显示全部楼层
I'm so sorry!
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sqazsq
发表于 2008-9-23 02:03:32 | 显示全部楼层

MentorGraphics:高级验证方法学(AVM)中文版: SystemVerilog and SystemC

MentorGraphics:高级验证方法学(AVM)中MentorGraphics:高级验证方法学(AVM)中文版: SystemVerilog and SystemCMentorGraphics:高级验证方法学(AVM)中文版: SystemVerilog and SystemCMentorGraphics:高级验证方法学(AVM)中文版: SystemVerilog and SystemC文版: SystemVerilog and SystemC
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hardstone_china
发表于 2008-10-27 14:54:44 | 显示全部楼层
不错！谢谢分享！
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modelsim64
发表于 2009-3-18 09:58:01 | 显示全部楼层

thank you

thank you
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modelsim64
发表于 2009-3-18 10:02:22 | 显示全部楼层

thank you

thank you
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