FPGA约束文件

方出旭旭 · 发表于 2024-5-27 14:18:17

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求助一下各位大佬：
   FPGA约束文件都有哪些啊？
   Quartus的约束文件和Vivado的约束文件是一样的吗？

   配置引脚算是对引脚进行约束吗？

ee_wang7788 · 发表于 2024-5-27 17:00:37

物理约束、时序约束，配置引脚算是对IO进行约束

方出旭旭 · 发表于 2024-5-29 17:06:57

ee_wang7788 发表于 2024-5-27 17:00
物理约束、时序约束，配置引脚算是对IO进行约束

请问物理约束和时序约束文件是需要自己编写吗？

为什么我在用FPGA的过程中好像没有写过约束文件啊

数学必考150 · 发表于 2024-5-29 17:14:45

方出旭旭发表于 2024-5-29 17:06
请问物理约束和时序约束文件是需要自己编写吗？

为什么我在用FPGA的过程中好像没有写过约束文件啊

有图形界面{tool -> time analyzer}可以点一点进行约束也可以自己编写sdc qsf文件只是看你自己喜欢；还有就是看你跑什么过程吧前仿跑一些简单的模块可能不需要这些东西到后仿综合才需要

方出旭旭 · 发表于 2024-5-29 18:22:13

数学必考150 发表于 2024-5-29 17:14
有图形界面{tool -> time analyzer}可以点一点进行约束也可以自己编写sdc qsf文件只是看你自己喜欢；还 ...

哦哦哦，可能我只用来驱动DAC芯片之类的，就还没用到过约束

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