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[求助] DRC出错

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发表于 2023-5-29 22:38:20 | 显示全部楼层 |阅读模式

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报错如下:PO.R.19 { @ Floating gate is prohibited if the effective source/drain are not connected together. Floating gate in the DRC is as follows: (1) GATE without Poly CO (2) GATE with Poly CO but not connected to MOS OD, STRAP or PAD. (3) It is not a floating gate if the GATE is connected to OD by butted CO in SRAM bit cell. The effective source/drain in DRC is as follows: (1)Source/drain is connected to different {MOSOD NOT PO}, STRAP, Gate, or PAD. This rule is only checked on the whole chip, not on the IP level   
  (Float_GATE_check INTERACT NSDu > 1 BY NET) NOT INSIDE SRAM_WAIVE_N28
  (Float_GATE_check INTERACT PSDu > 1 BY NET) NOT INSIDE SRAM_WAIVE_N28
}
输入栅极都连接焊盘了还报错

发表于 2023-5-30 09:13:08 | 显示全部楼层
可能需要PAD上加label?空PAD和Floating一样的
发表于 2023-5-30 09:28:08 | 显示全部楼层
gate没接
发表于 2023-5-30 09:44:26 | 显示全部楼层
这不是recommend rule嘛,可以waive吧
 楼主| 发表于 2023-5-30 22:11:32 | 显示全部楼层


freshworker 发表于 2023-5-30 09:13
可能需要PAD上加label?空PAD和Floating一样的


打了label,而且两个相同连接的相同子模块,放到顶层,一个报错一个不报

 楼主| 发表于 2023-5-30 22:13:11 | 显示全部楼层


gate接了焊盘,top用了很多这个模块,有些gate没接的反而没报错,报错毫无规律可言
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