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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › 版图绘制的几个疑问
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查看: 1626|回复: 4

[求助] 版图绘制的几个疑问

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youngyq
发表于 2022-12-2 14:04:26 | 显示全部楼层 |阅读模式

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本帖最后由 youngyq 于 2022-12-2 14:09 编辑

我知道是原理图与版图上相对应不一致，但是不明白这个Nets指的的什么，ports指的是输入端口，instances指的是器件原理图和版图如下所示，我自己核对了很多遍，两者是相会对应上的，但是LVS验证的时候又确实报了两者不一致的错误

这是绘制版图的报错

这是绘制版图的报错

这是原理图

这是原理图

这是版图

这是版图
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李幕白
发表于 2022-12-2 14:37:11 | 显示全部楼层
NET就是连线，一般版图会比电路图多得多
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jsonli0201
发表于 2022-12-2 15:02:41 | 显示全部楼层
这个电路应该可做成standcell，试着弄一下
net错误是连线错误 ，ports错误一般是PIN是否错误，instances错误一般是器件类型、器件属性、器件个数等错误，
我一般是先解决ports错误，再net错误，上述如有问题请各位大佬指正。
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墨离
发表于 2022-12-5 10:35:15 | 显示全部楼层
这不是个数字的模块么，怎么都分散开来了画，数字模块应该追求面积最优吧
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墨离
发表于 2022-12-5 10:40:07 | 显示全部楼层
这个就是ports，net一般指用金属层去连接各个mos管得，一般性版图中会比电路中多
1670207913204.jpg
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