ADC内负压的产生原理

杨原仪 · 发表于 2022-6-30 10:48:24

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本职工作是版图对电路不是太懂想请教各位大佬门一个问题在ADC里面遇到一个问题这里VSS通过INV产生一个VSSBUF，理论上这个VSSBUF是一个负压，在模块外面这个VSSBUF是给一个模块做地，这个模块地是VSSBUF 电源是一个2.3V的电压。但是我在想图中这个模块电流是VSS>>VSSBUF 另一个模块是VDD>>VSSBUF 其他地方也没有看到和VSSBUF有通路的地方那VSSBUF这个信号不就是只有入没有出了吗。

john_123 · 发表于 2023-4-7 22:48:20

thanks

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