在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
123
返回列表 发新帖
楼主: 220194952

[讨论] 通过Cadence中的Eye Diagram眼图仿真可以看设计的PLL的时钟抖动吗?

[复制链接]
发表于 2025-4-21 09:31:47 | 显示全部楼层
学习了,mark一下!
发表于 昨天 09:06 | 显示全部楼层


zhwchaser 发表于 2020-7-21 12:25
首先,不准确的讲,VCO的频率是无法精确测出来的,因为不是固定频率Fref * N这种形式;
VCO应该只能测出来p ...


大佬,按你的方法做了,这眼图看上去似乎是N个周期在power/2出的叠加,在power/2处的时候最窄,然后在两侧逐渐变宽,这时候看jitter怎么看呢?是看最窄处的宽度吗?
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-5-8 03:08 , Processed in 0.013218 second(s), 7 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表