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查看: 10007|回复: 6

《Verilog In for Design Framework II User Guide and Reference》

whgsycl whgsycl 当前离线积分 965 头像被屏蔽	发表于 2007-4-18 21:00:29 \| 显示全部楼层 \|阅读模式提示: 作者被禁止或删除内容自动屏蔽
whgsycl whgsycl 当前离线积分 965 头像被屏蔽	相关帖子 • cadence ic610的 virtuoso在哪里生成symbol • 资深电机设计、控制技术VIP交流平台欢迎你的加入 • 大家有空可以看看 • Digital Integrated Circuit Design - Ken_Martin 省錢版 pdf • 【AMD社招】Senior /MTS Engineer of Physical Design • 【AMD社招】SMTS ASIC Design Verification Engineer • synopsys上海招聘后端应用工程师Physical Design Application Consultant • 知名外资公司（上海）急聘PM(芯片开发）！！！
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ZTZ ZTZ 当前离线积分 108 头像被屏蔽	发表于 2007-5-2 16:38:16 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
ZTZ ZTZ 当前离线积分 108 头像被屏蔽	EETOP创芯人才网职位发布入口
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发表于 2007-5-5 21:25:56 | 显示全部楼层

英文的。。。。。。

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发表于 2007-10-28 13:16:03 | 显示全部楼层

than ks

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发表于 2011-2-21 21:50:01 | 显示全部楼层

什么东西都没有啊

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发表于 2011-2-21 22:25:49 | 显示全部楼层

有甚麼東西？

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发表于 2018-1-8 10:51:29 | 显示全部楼层

thanks

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