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[求助] dracula无法提取LPNP。求帮助

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发表于 2013-2-1 16:15:18 | 显示全部楼层 |阅读模式

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x
;************************************************************************
;******SA5V Bipolar(double metal)LVS Dracula command file**************
rocess:SA5V double metal process
;Release date:2013-1-29
;************************************************************************
;This file is made to check the following devices:
;NPN transistor            model:NP
;LPNP transistor           modelN
;capacitor(Metal-emitter)  model:Cm
;FB resistor               model:RB
;FR resistor               model:FR
;************************************************************************
;              MODEDICATION   LOG
;
;    DATE       WHO        COMMENT
;------------------------------------------------------------------------
;************************************************************************
;                     DESCRIPTION
;************************************************************************
*DESCRIPTION
     PROGRAM-DIR    =/EDA/IC5141/tools.lnx86/dracula/bin/
     LIBRARY        = /home/songdd/work/rm604/D705
     PRIMARY        = h305_flat
     INDISK         = h305_flat.gds
     PRINTFILE      = lvs
     OUTDISK        = h305_flat
     SYSTEM         = GDS2
     RESOLUTION     = .001 MICRON
     SCALE          = .001 MICRON
     MODE           = EXEC NOW
     KEEPDATA       = YES
     LISTERROR      = yes
     SCHEMATIC      = LVSLOGIC.DAT
     POWER-NODE     = VCC*,AVCC,DVCC,VDD*,AVDD,DVDD
     GROUND-NODE    = VSS*,AVSS,DVSS,GND*,AGND,DGND
     TEXT-LEVEL     = 0
     UNIT           = CAPACITANCE, pf resistance k
     MODEL          = BJT[PN],PNP  BJT[NP],NPN
     LEGAL-CHAR-SET = !
     CNAMES-CSEN    = yes
     TNAMES-CSEN    = no
     WORK-DIR       = /home/songdd/work/rm604/LVS/h305/
     DELCEL         = logo
;
    *END
;*************************************************************************
;                         INPUT-LAYER
;*************************************************************************
*INPUT-LAYER
;
GE     =  1                 ;;Buried Layer
SG     =  2                 ;;Active Layer
ID     =  3                 ;;ISO
PCD    =  4                 ;;Deep N
FBD    =  5                 ;;In-Base
FRD    =  6                 ;;Ex-Base
PG     =  7                 ;;Capasitor
NSC    =  8                 ;;Si3N4
NPI     =  9                 ;;Emitter Window
ND     =  10                ;;Emitter
NS     =  11                ;;Contact Etch
NSI    =  12                ;;Contact
LA     =  13  TEXT 13 ATTACH LA              ;;1st Metal
NBI     =  14                ;;Via
LB     =  15  TEXT 15 ATTACH LB              ;;2st Metal
C      =  16                ;ad
SUBSTRATE = BULK 0
CONNECT-LAYER=  LPC LPE VNB RBTM RRTM D_FB  LA LB  
; TEXTSEQUENCE = LB LA
;
   *END
;
;*******************************************************
*OPERATION
;
;------- Logical operations --------------------------------------------
AND       ID    SG    I                           ;
AND       PCD   SG    PC                          ;
AND       FRD   SG    FR                          ;
AND       FBD   SG    FB                          ;        
NOT       BULK  I     EPI                         ;
;-------find  devices---------------------------------
; LPNP
;AND       FR    EPI   FR_N_I                        ;ideal 1 of finding LPNP
;EXT[HR]   FR_N_I  LE  18 LPC                     ;
;NOT       FR_N_I  FR  LPE                        ;
;
SEL    FRD   INSIDE    SG   SG_FR                  ;ideal 2 of finding LPNP
SEL    SG_FR INSIDE    GE   LPE                    ;
SIZE   LPE   BY 4     LPE_4                 ;
SEL     FR  TOUCH    LPE_4     LPC                ;
;
;SEL    FRD   INSIDE    SG   SG_FR                  ;ideal 3 of finding LPNP
;SEL    SG_FR INSIDE    GE   LPE                    ;
;SIZE      LPE BY 7     LPE_8                 ;
;AND    LPE_8   FR     LPE_FR                ;
;NOT   LPE_FR   LPE    LPC                    ;
;
;
;SIZE  LPC  BY 4     LPC_B1    ;
;SEL   PCD  TOUCH LPC_B1   LPB_PCD  ;
;AND   LPB_PCD   SG   LPB      ;
;
;WIDTH     LPC_B1      LT 90            OUT DRO03  63;TEST
;WIDTH     LPB_PCD     LT 90            OUT DRO02  63;TEST
WIDTH     LPC         LT 20            OUT DRO04  63;TEST
WIDTH     LPE         LT 20            OUT DRO05  63;TEST
;WIDTH     LPB         LT 90            OUT DRO01  63;TEST
WIDTH     EPI         LT 90            OUT DRO06  63;TEST
;WIDTH     BULK         LT 90            OUT DRO07  63;TEST
;
;npn
NOT       FB    NPI    FB_N_NP                     ;
SEL       NPI    HOLE  FB_N_NP     VNE             ;
SEL       FB    ENCLOSE  VNE      VNB             ;
WIDTH     VNE         LT 90            OUT DRO07  63;
;CAP
AND       PG    LA    CPA                       ;
SELECT    PCD   ENCLOSE   PG      C_PCD           ;
AND       C_PCD SG    CPB                       ;
;RES_FB
NOT       FB    VNB    RES_FB                     ;
SEL       NSI   TOUCH  RES_FB      R_FB_NI        ;
SIZE      R_FB_NI  BY  4         RBTM          ;
NOT       RES_FB  RBTM         RBBD         ;
;RES_FR
SEL       FRD   ENCLOSE  SG       R_FRD           ;
AND       R_FRD  SG                R_FR            ;
SEL       NSI   INSIDE   R_FR     R_FR_NI        ;
SIZE      R_FR_NI  BY  4         RRTM         ;
NOT       R_FR  RRTM           RRBD         ;
;DIODE
SEL       FBD   ENCLOSE  LPC     LP_C_FB        ;
NOT       FBD   LP_C_FB          FB_TMP1        ;
SEL       FB_TMP1  TOUCH  PCD  D_FBD           ;
AND       D_FBD SG                D_FB            ;
SEL       PCD   TOUCH   D_FBD   D_PCD           ;
AND       D_PCD SG                D_PC            ;
;
;
;------- Logical operations --------------------------------------------
NOT       NPI   VNE   NPITMP     ;
NOT       NPITMP  CPB   EPI_NP  ;contact(NP) on epi
;
;
;--------define node information------------
CONNECT   LA    LB   BY NBI                        ;
CONNECT   LPC   LA   BY NSI                       ;
CONNECT   LPE   LA   BY NSI                       ;
CONNECT   VNB   LA   BY NSI                       ;
CONNECT   RBTM   LA   BY NSI                       ;
CONNECT   RRTM   LA   BY NSI                       ;
CONNECT   D_FB   LA   BY NSI                       ;
;
STAMP     EPI_NP     BY LA                        ;
STAMP     PC         BY EPI_NP                        ;
STAMP     EPI        BY PC                        ;
STAMP     VNE        BY LA                        ;
STAMP     CPA        BY LA                        ;
STAMP     CPB        BY PC                        ;
;STAMP     LPB        BY LA                        ;
STAMP     D_PC       BY PC                        ;
;------------ELEMENT------------------------
ELEMENT     BJT[NP]  VNE     EPI   VNB   VNE
ELEMENT     BJT[PN]  LPE    LPC  EPI   LPE
;
ELEMENT     CAP[CM]  PG      CPA  CPB
PARAMETER   CAP[CM] 0.00106E-12 ;
;
ELEMENT     RES[FB]  RES_FB    RBTM
PARAMETER   RES[FB]  1.1
ELEMENT     RES[RP]  R_FRD    RRTM
PARAMETER   RES[RP]  0.25
;
ELEMENT     DIO[Cj]  D_FBD   D_FB  D_PC
;
;
MULTILAB OUTPUT  SHORT  30
SAMELAB  OUTPUT  OPEN   30
;
      LVSCHK[ERX]  RESWPERCENT=0
      LVSCHK[ERX]  RESLPERCENT=0
      LVSCHK[ERXP] CAPVAL=1
      LVSCHK[ERX]  EAPER=1
      LVSCHK[ERX]  DIOAREA=1
      LVSCHK[ERX]  DIOPERI=1
      LVSCHK[ERX]  WPERCENT=0 LPERCENT=0
;

*END

这个是我写的dracula commands file 做lvs用的。但不知为什么软件就是无法提取LPNP。
通过验证我发现软件可识别到LPE和LPC。
图中画线部分为所用语句。
在线等,大神啊,救救我,让小弟过个好年
 楼主| 发表于 2013-2-1 16:17:51 | 显示全部楼层
图中笑脸,为转码后显示,小弟提前并不知情啊。
 楼主| 发表于 2013-2-1 16:22:39 | 显示全部楼层
画线部分未显示,下文标出
SEL    FRD   INSIDE    SG   SG_FR                  ;ideal 2 of finding LPNP
SEL    SG_FR INSIDE    GE   LPE                    ;
SIZE   LPE   BY 4     LPE_4                 ;
SEL     FR  TOUCH    LPE_4     LPC                ;
;
。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。
。。。。。。。。。。。。。。。。。。。。。。。
ELEMENT     BJT[PN]  LPE    LPC  EPI   LPE
 楼主| 发表于 2013-2-1 17:18:05 | 显示全部楼层
已解决,呵呵
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