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LVS求助

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发表于 2010-5-26 12:03:59 | 显示全部楼层 |阅读模式

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用cadence的assura跑LVS,结果电路器件和版图器件无法对应起来。工艺是smic0.18工艺文件。我感觉是binding.rul文件的有些问题,求高手指点一下,现在的binding.rul文件内容是:
c RESISTOR rndifsab
c N18           n18
c P18           p18
c N18           NPD
c N18           NPG
c P18           PL
c n33          n33
c p33           p33
c PNP18A4  pnp18
c PNP18A25 pnp18
c PNP18A100 pnp18
c PNP33A4 pnp33
c PNP33A25 pnp33
c PNP33A100 pnp33
c NPN18A4 npn18
c NPN18A25 npn18
c NPN18A100 npn18
c NPN33A4 npn33
c NPN33A25 npn33
c NPN33A100 npn33

再问一下这个句型是什么意思呢?
 楼主| 发表于 2010-5-26 14:31:56 | 显示全部楼层
问题比较急,我在线等高手指点!多谢了
 楼主| 发表于 2010-5-26 16:15:12 | 显示全部楼层
刚刚解决了一些问题,发现有根线跟VDD短接了,mos管都可以认出来,只是BJT管都认不出来。以前我也碰到过这种情况,当时师兄说这个问题可以不管,如果谁能知道解决方案的请指点一下,多谢了!
发表于 2010-5-29 14:00:38 | 显示全部楼层
问题解决了吗?
发表于 2010-6-1 14:50:12 | 显示全部楼层
这上面都是下资料来的,解决问题的少
发表于 2010-7-15 06:33:07 | 显示全部楼层
aaaaaaaaaaaaaaaa
发表于 2010-10-25 14:55:59 | 显示全部楼层
看一看BJT的类型是否用错,以及netlist里面的参数
发表于 2010-12-11 18:36:11 | 显示全部楼层
这个需要仔细找
发表于 2010-12-11 22:07:36 | 显示全部楼层
我没有见过这个句型
发表于 2013-6-18 21:03:42 | 显示全部楼层
没有这样句型啊
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