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电子资料:5G承载光模块测试方案介绍 |有奖下载: 300信元+27个幸运抽奖)
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[求助] LVS报错 遇到not define的问题

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发表于 2020-3-24 10:59:07 | 显示全部楼层 |阅读模式
10资产
LVS 仿真时 遇到如下问题:
   source netlist references but does not define(1) subckt: rhrpo_ckt

请问这个如何解决?

微信图片_20200324105537.png
发表于 2020-3-25 10:26:53 | 显示全部楼层
缺失了rhrpo_ckt的subckt文件
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 楼主| 发表于 2020-3-26 08:38:49 | 显示全部楼层


   
muyu8780 发表于 2020-3-25 10:26
缺失了rhrpo_ckt的subckt文件


请问下这个怎么解决呀
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发表于 2020-3-26 15:18:23 | 显示全部楼层


   
lyz1991cn 发表于 2020-3-26 08:38
请问下这个怎么解决呀


要去找这个subckt文件,做v2lvs的时候include进去
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发表于 2020-3-26 16:12:16 | 显示全部楼层
缺了rhrpo_ckt的子网表文件
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发表于 2020-3-26 22:41:16 | 显示全部楼层
v2lvs -v pll_logic.vm -l /home/work/project/demo/techfile/verilog/scc018ug_hd_rvt.v -o pll_logic.spi -s /home/work/project/demo/techfile/cdl/scc018ug_hd_rvt.cdl
添加cdl文件的路径
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