关于时钟树减少问题

糖糖123 · 发表于 2018-2-9 17:06:30

请教一下，longestpath怎样减小呀，我试了set_clock_tree_opition，有作用，但只减小了一点，这个值还是有点大，还有其他办法吗？

apollo6 · 发表于 2018-2-9 17:06:31

报一下最长的几条path 看下为什么走这么长，1、是不是有drc问题max_transition max_fanout ...
2、是不是时钟路径有问题是否可以设exclude pin stop pin
如果都没问题
1、clock trantion 设大点
2、用大驱动的clk buf
3、调整floorplan

糖糖123 · 发表于 2018-3-12 11:16:18

回复 2# apollo6

请问你的第一点是什么意思呀？drc的问题跟这个关系不大吧

apollo6 · 发表于 2018-3-12 17:57:37

回复 3# 糖糖123

不是让你看一下么？看看会不会是drc的原因导致时钟树路径比较长嘛

糖糖123 · 发表于 2018-3-13 14:33:58

回复 4# apollo6

哦哦，怎么看是不是DRC导致的，没有这样看过，请教一下大神。

apollo6 · 发表于 2018-3-14 17:50:25

回复 5# 糖糖123

report_clock_tree -clock XXX

糖糖123 · 发表于 2018-3-16 09:50:16

回复 6# apollo6

DRC报告 6LO$TALCWHQN[~0VTEC@_8G.png

这个是绝对值最大的slack，好像都是transition的问题，是要加BUF来修吗？

apollo6 · 发表于 2018-3-16 12:28:41

回复 7# 糖糖123

修不修的不重要重要的是去看为什么工具没解掉

糖糖123 · 发表于 2018-3-16 15:02:41

本帖最后由糖糖123 于 2018-3-16 15:10 编辑

回复 8# apollo6
从layout中看，最长的DRC是由于net太长，工具没修掉，需要手动加什么命令，能修？还有如果调整floorplan将所有clock tree的cell都放到一起（root PIN的附近），会有其他影响吗

chj1294427354 · 发表于 2018-3-20 20:34:49

试着设置max buffer depth;或者使用大一点的inverter。再不行就尝试使用LVT，长tree

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