1.2V的LDO设计问题

拉神追随者 · 发表于 2017-2-21 20:10:12

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RT，想要设计一个输出1.2V的LDO,如果用1.2V的基准，可不可以将运放的反馈端直接接到LDO的输出（将传统LDO的电阻分压网络变成单个电阻），这样做会不会有什么问题？求大神们指点啊

popfly51 · 发表于 2017-2-22 10:16:47

取决于性能的要求，如果驱动能力，瞬态响应等指标符合要求，这种设计就没有问题。

typhoon222 · 发表于 2017-2-22 15:51:29

取决于性能的要求，如果驱动能力，瞬态响应等指标符合要求，这种设计就没有问题。
popfly51 发表于 2017-2-22 10:16

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这样可以给数字电路供电么？

nwpu_boy · 发表于 2017-2-22 19:38:07

不可以。（1）驱动能力不够。（2）你这样设计最多最多只能叫做稳压器，不能叫LDO。如果运放的反馈端当做输出，Low Dropout Output在哪里体现？？？你可以产生一个低于1.2V基准，不一定非得用带隙基准啊。

拉神追随者 · 发表于 2017-2-22 22:07:31

回复 2# popfly51

学习了！

popfly51 · 发表于 2017-2-23 09:17:45

回复 3# typhoon222
数字电路门数不多的话，没什么问题。

king0798 · 发表于 2017-2-23 09:22:23

回复 4# nwpu_boy

Low dropout指的是 input voltage和output voltage的差值吧，请教怎么不行了？

typhoon222 · 发表于 2017-2-23 10:39:18

回复 typhoon222
数字电路门数不多的话，没什么问题。
popfly51 发表于 2017-2-23 09:17

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不多是指多少呢？

aircraft · 发表于 2017-2-23 12:10:57

用1.2V做VREF LDO单位增益buffer 原理上一点问题都没有但前提是ldo的性能要保证，譬如精度要求比较高，一般都是通过修fb端的电阻，假如你基准出来的偏差了并且没有trimming，那么这种流出来的精度就要差一些

dundun22 · 发表于 2017-2-23 12:42:21

可以，feedback factor=1，比较难stable。

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