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[求助] UVM相对于纯SV验证平台的优势在哪里?

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发表于 2016-2-14 20:49:23 | 显示全部楼层 |阅读模式

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如题,最近在准备毕业设计的开题报告
做的是基于纯SV的验证平台向UVM的快速转化

在写报告的时候突然想到一个问题

之前了解到的都是在验证平台还没搭出来的前提下UVM的优点,可是如果现在已经有一个基于纯SV的验证平台了,为什么又要把它转化为UVM平台的呢?


或者说,基于UVM的验证平台相对于已经搭好的基于SV的平台的优势在哪里呢?


感谢解答!
发表于 2016-2-14 21:24:57 | 显示全部楼层
要不要重新造轮子的问题。。。。。
发表于 2016-2-14 21:50:56 | 显示全部楼层
一、重用性
1.假设你要使用别人的IP,别人使用UVM,而你不是,显然不利于集成到自己的环境中去
2.假设你公司做验证的人走了,如果平台是UVM搭建的,显然有利于新招聘的人更快的上手
3.同一个项目组大家都使用UVM,更容易沟通,相互重用以及集成。
二、易用性
1.UVM是目前公开的最先进的验证方法学,从架构、流程、工具,帮你实现了很多东西
2.主流EDA工具支持,更便于调试
三、个人发展更好,员工更乐于学习接受

个人浅见,本人UVM小菜鸟
 楼主| 发表于 2016-2-15 11:18:39 | 显示全部楼层
回复 3# luyaker


   谢谢。   您说的有道理,不过我更想知道,单就两个验证平台的性能而言,UVM较SV的优势在哪里呢?
 楼主| 发表于 2016-2-15 11:19:30 | 显示全部楼层
回复 2# A1985


   能详细解释一下吗,刚开始学的UVM,理解的不太好,谢谢。
发表于 2016-2-15 11:31:19 | 显示全部楼层
回复 4# JVever

UVM也是sv写的,你这个问题,就像是降龙十八掌和你自创的掌法比威力。哪个威力大?看你的水平咯。而且降龙十八掌也需要学习到一定水平,不然也是没威力,当然学习降龙十八掌所花的时间,绝对是值得的。
发表于 2016-2-25 11:41:16 | 显示全部楼层
其实我也在想这个问题,是否需要把目前的平台用UVM平台来实现,之所以迟疑,是因为我们自己的平台比较简单,DUT的规模也不大,开发了很多芯片也没出什么问题,所以感觉使用UVM是大材小用了。

我们目前的平台就是SV的平台,DUT规模大概500万门,平台结构很简单:
111.JPG
 楼主| 发表于 2016-2-26 13:07:38 | 显示全部楼层
回复 7# welco


    通过这几天的了解,我觉得可能从长远来看,早晚得升级的,UVM就像是从SV进化出的一个通用工具,使用它的代价可能是性能上的略微下降,但好处是可移植性、重用性更好了,一个东西用SV写可能有好几种写法,但UVM给规范化了,不同的开发人员都用这个来交流,可以避免理解错误,降低了沟通成本。
发表于 2016-2-29 16:11:12 | 显示全部楼层
对于个人来讲,UVM和SV实际上没差别,个体思维自身是重用的,即使是verilog,但对team work来讲,没有规范约束,时间会让一切变成shit,更别说重用了。
发表于 2016-3-2 07:49:11 | 显示全部楼层
Why the forums are so quiet this week ?

Does every one go to vocation ?
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