spartan6的时钟输出

574920045 · 发表于 2015-7-27 08:33:25

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我想通过spartan6的差分引脚输出内部的时钟出来给外部器件使用，不知道这个输出的时钟最高能设置多大！输出的差分引脚要用全局时钟引脚比较好还是普通的差分引脚比较好呢？

yy1989413 · 发表于 2015-7-27 09:09:38

同求..........

574920045 · 发表于 2015-7-27 09:50:30

万能的网友，大家指点一下啊！

haitaox · 发表于 2015-7-27 09:59:49

spartan6不能时间把时钟输出到引脚上，必须借助于oddr2或者oserdes，时钟频率低的用oddr2就可以。高的话，就必须用oserdes了。

574920045 · 发表于 2015-7-27 11:05:40

回复 4# haitaox

这个输出时钟的大小有什么界定的值呢？oddr输出可以达到多少？超过多少用oserdes？这个oserdes不是串行解串吗？如何做时钟输出呢？

haitaox · 发表于 2015-7-29 14:03:30

回复 5# 574920045

iserdes是串并转换，oserdes是并串转换。
具体的速率可以看看ds162，里面说的非常详细。

574920045 · 发表于 2015-7-29 15:02:02

回复 6# haitaox

谢谢，我想问一下，如果使用ISERDES串并转换模块，那个我的差分输入信号需要在同一个half bank中吗？如果用selectIO模块使用ISERDES功能，好像差分输入不在一个halfbank中，编译就会报错。现在板子已经画好了，差分输入信号都在同一个bank中，但是不在同一个halfbank中啊！不知道有没有解决方法！

haitaox · 发表于 2015-7-31 16:26:51

使用iserdes解串，可以有2种方法，1是bufpll的方法，2是bufio2的方法。
bufpll的方式，时钟可以放在任意的bank，但最好放在与数据相同的bank这样时钟走线最短，质量最好。所有数据必须放到同一个Side(4个bank的器件中，side就是一个bank)中
bufio2的方式，时钟要与数据放在同一个half bank，所有数据必须放到同一个Half Side中
注释：在4个bank的器件中，一个bank就是一个side。在6个bank的器件中，bank0和bank2各是一个side。bank1+bank5是一个side。bank3+bank4是一个side。

seth781500 · 发表于 2015-7-31 17:46:25

幫頂一下喔

574920045 · 发表于 2015-8-3 08:20:43

回复 8# haitaox

谢谢，长知识啦！

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