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楼主: leapoo

[求助] UVM中SVA可不可以加在DUT内部的block中

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发表于 2014-8-13 15:15:28 | 显示全部楼层
你是怎么弄的?呵呵  学习一下
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发表于 2014-8-13 22:41:01 | 显示全部楼层
uvm会火吗?
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 楼主| 发表于 2014-8-14 04:52:47 | 显示全部楼层
回复 12# yccmrcool


   公司让我做说明可以的阿
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 楼主| 发表于 2014-8-14 04:53:26 | 显示全部楼层
回复 11# allencherry


   就是直接把assertion写在内部block中,makefile中vsim加命令能看到
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发表于 2014-8-14 08:27:08 | 显示全部楼层
就是直接把assertion写在内部block中
什么block? vsim 后面加什么选项?
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