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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 差分输入对管共质心版图画法的疑问
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[求助] 差分输入对管共质心版图画法的疑问

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发表于 2014-7-17 13:24:07 | 显示全部楼层 |阅读模式

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本帖最后由 土豆烧牛肉WOW 于 2014-7-17 13:25 编辑

大家好，请教一个关于差分对版图的问题，我画的是电阻负载的差分对，输入对管采用共质心画法，指数为10，ABBAABBAAB对应BAABBAABBA，栅极交叉连接，其中一部分栅接在一起作为输入IN1，剩下的部分接一起作为输入IN2，现在LVS的Nets总提示节点个数不匹配，说是原理图中1个节点，版图中却有2个。。是不是因为共质心的画法，需要把MOS管的多晶栅拆成交叉两个造成软件识别不了？初学版图，谢谢指教。 LVS报错图.png
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 楼主| 发表于 2014-7-17 13:28:43 | 显示全部楼层
回复 1# 土豆烧牛肉WOW


    总体版图.png 原理图.png 差分输入对共质心版图.png
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 楼主| 发表于 2014-7-17 13:51:53 | 显示全部楼层
顶。。。
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仿真小助手
发表于 2014-7-17 17:13:35 | 显示全部楼层
你是哪个服务器的呀  老是感觉见过这ID
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 楼主| 发表于 2014-7-17 18:09:12 | 显示全部楼层
回复 4# 仿真小助手


   不在服务器上，自己电脑里的IC5141USER6，用的TSMC.35的工艺做的练习
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fuyibin
发表于 2014-7-17 20:42:52 | 显示全部楼层
本帖最后由 fuyibin 于 2014-7-17 20:46 编辑

这个layout做的不是不好，是非常不好。做layout不要去追求那些奇淫技巧，俗话说重剑无锋，大巧不工。
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 楼主| 发表于 2014-7-17 22:12:55 | 显示全部楼层
解决了。。。。。。要注意漏源对应以及共用的问题。
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 楼主| 发表于 2014-7-17 22:14:07 | 显示全部楼层
回复 6# fuyibin
恩，我会考虑时间与效率以及匹配的折中的问题，另外谢谢你的建议
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hujiaomianhao
发表于 2014-7-18 08:11:38 | 显示全部楼层
学习中！！！
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xxmule
发表于 2014-7-18 10:38:43 | 显示全部楼层
好奇的问下，Nets Mismatch Tool是怎么弄出来的啊？

回复 1# 土豆烧牛肉WOW
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