数据速率转换

qiudanyi1 · 发表于 2014-2-11 16:31:05

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请问怎么用verilog实现数据速率的转换啊？

eaglelsb · 发表于 2014-2-11 18:22:31

你描述清楚点

qiudanyi1 · 发表于 2014-2-11 19:55:11

回复 2# eaglelsb
不好意思啊，我现在把我想解决的问题给描述一下，就是想将100Mbps的数据速率转换成10Mbps的数据速率，并且数据是连续的，用FPGA去实现，你觉得有什么好的解决方法吗？

LQCONAN · 发表于 2014-2-12 11:44:44

回复 3# qiudanyi1

下抽10倍不就得了。
DDC

qiudanyi1 · 发表于 2014-2-12 12:53:32

回复 4# LQCONAN

请问可以说的详细一点吗？谢谢

qiudanyi1 · 发表于 2014-2-12 12:59:01

回复 4# LQCONAN
你好，请问可以说的详细一点吗？谢谢

jacobshen · 发表于 2014-2-12 15:56:15

数据信号降采样？滤波器+抽取

silencex8 · 发表于 2014-2-12 18:34:57

这要看具体需求了：如果是数据采样/抽样，那么就可以用10M的频率直接采样(考虑是否存在亚稳态了)
如果是数据传输，那么就需要使用FIFO或其他双端口存储设备，先存储，在读取传输的方式

chunyuan2014 · 发表于 2014-2-12 22:23:04

先抓取数据存储，再通过时钟读出，注意按要求控制好数据交换及保护。

loecd4346 · 发表于 2014-2-12 23:01:53

你使用同一个时钟吗？还是高速率低速率不同时钟？

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