做个调查，谁做过数字校正的adc

adcer · 发表于 2013-7-3 13:40:15

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不是pipeline的错位相加。是用lms或dither或其他算法，foreground和background都算，不局限于pipeline结构，谁做过

adcer · 发表于 2013-7-3 13:41:49

或者你身边或你公司有人做过，做到什么程度，欢迎一起讨论

jiang_shuguo · 发表于 2013-7-3 13:50:52

dynamic element match 算是数字校验么？

adcer · 发表于 2013-7-3 14:55:44

回 jiang_shuguo，我觉得算是，不知你是应用在sigmadelta还是别的结构里边

jiang_shuguo · 发表于 2013-7-3 15:38:13

是用在ADC里面的，别人做的，我见过呵呵。我没做过。

adcer · 发表于 2013-7-3 23:58:00

大家共同讨论讨论，许多人觉得数字校正只是发论文用的，成熟芯片用的很少，所以发个帖子征求一下大家的看法，请大家捧场

VisionSim · 发表于 2013-7-4 00:15:27

回复 6# adcer

我还以为现在只要是ADC都做数字矫正

adcer · 发表于 2013-7-4 00:32:38

高水平的论文几乎全都靠数字校正拉高sndr或降功耗，但市场上的高性能芯片往往功耗都挺吓人的，个人猜想其性能还是靠模拟电路做大做强来保证的，校正用的不多，更高性能的干脆就不用cmos工艺了，照理说adi的大牛没少发校正的文章，为什么产品里不多见？难道仅仅是认为现有产品有足够竞争力而舍不得过早推出新技术？

adcer · 发表于 2013-7-4 00:38:19

常看到adi,synopsys里的人发很牛的论文作品，但几年过去了从他们的产品列表中都没发现类似的产品上市，why？

hezudao · 发表于 2013-7-4 01:56:25

回复 9# adcer

工业界需要calibration 的adc也是大把大把的，12bit以上不calibrate比较少，os adc除外

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