SystemVerilog经典教材

haitaox · 发表于 2012-9-17 15:12:45

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SystemVerilog已经成为IC验证的王牌工具，而在很多设计当中，sv也是作为设计语言出现的
很辛苦找来的资料，非常清晰，与各位IC同志共勉

qiuabc511215960 · 发表于 2012-9-18 19:26:16

这个可以有~~~~

逆光的鸟 · 发表于 2012-9-21 14:10:39

LS威武支持下

mazifa · 发表于 2012-9-21 21:50:58

谢谢....

flyingstar · 发表于 2012-9-21 23:45:58

就是systemverilog的语言参考手册吧

pupukid · 发表于 2012-9-22 09:50:26

reference manual !

ningyuan198 · 发表于 2012-9-27 16:03:18

下资料留名！

easelive · 发表于 2012-10-2 13:21:58

eetop

leiya21 · 发表于 2012-10-2 23:28:36

回复 1# haitaox

是的是的！

zhanglinlin0514 · 发表于 2012-12-20 23:19:26

谢谢楼主的分享

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