直接产生verilog的testbench的python脚本

haimag · 发表于 2012-2-7 21:23:34

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本帖最后由 haimag 于 2012-2-8 19:27 编辑

看得有人贴的直接生成testbench的perl脚本，
也贴一个python脚本，用法同perl脚本。
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该脚本适用于对verliog代码，直接生成testbench.
使用：在python编译环境中输入python vTbgenerator.py ModuleFileName.v

注意： ModuleFileName.v被替换成你所需要的例化文件，另外要将vTbgenerator.py ModuleFileName.v放在同一个文件夹中，这样就可以生成ModuleFileName.v的测试文件了。

vTbgenerator.zip (2.18 KB, 下载次数: 1979 )

wjhd · 发表于 2012-2-8 20:10:17

不错，谢谢。

jason_vip1 · 发表于 2012-2-14 11:44:43

Good Look Look

dzxxsys · 发表于 2012-3-31 21:38:45

直接产生verilog的testbench的python脚本

nano_2008 · 发表于 2012-3-31 23:34:15

八错八错

goalyoung · 发表于 2012-4-7 23:15:22

回复 1# haimag

wanted

chanon · 发表于 2012-6-16 23:16:09

谢谢！学习学习！

PETERZHAO2010 · 发表于 2012-7-23 11:31:34

有用吗？

leejiaxin · 发表于 2012-7-23 16:46:04

excellent sharing.

yuayuuu · 发表于 2012-10-20 21:56:33

先收藏了。。。

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