有谁知道芯片的门数是怎么计算的？

zgqgfkkkd · 发表于 2011-9-24 12:26:23

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介绍一款芯片的时候，总是会说此芯片有多少万门？
那么这个门数是怎么计算的？
是4个transistor算1个gate么？

icfbicfb · 发表于 2011-9-24 15:25:16

前端的算法是 dc report_area / nand2 面积得到

后端是instance 数量x 4倍即可，

1个gate 是可以按4个管子这么算，但是管子数目太大了，没法算

joemool · 发表于 2011-9-24 15:50:06

如果你是用encounter，那么恭喜你，它可以报告出相关门数！
第一个菜单栏下，倒数第二个选项的样子，下级菜单里有一个report gates（貌似是这个），然后apply，到启动目录下寻找报告出来的文件，你可以看到所有instance或者macro的gates数量。一般第一个顶层gates数量就是你这个design的gates...
我最近刚tape out的芯片，这个数字52575098就是这么出来的...

puyuwei · 发表于 2011-9-24 15:52:45

一般是把综合出来的面/一个基本单元的面积（与非门面积） = 等效的门数，这个只能作为一个粗略的估计，不是精确值...

puyuwei · 发表于 2011-9-24 15:57:11

一般是把综合出来的面积/一个基本单元的面积（与非门面积） = 等效的门数，这个只能作为一个粗略的估计，不是精确值...

question23 · 发表于 2011-9-24 16:37:43

回复 3# joemool

5千万门？不算小的设计了

icfbicfb · 发表于 2011-9-24 22:39:59

不就是reportGateCount 命令么，可以试下，

门都是大概估计，不是精确的，就是看看大概的规模而已，

后端还是看instance数量的，

Andreatong · 发表于 2011-9-25 18:42:46

逻辑单元的基本单元是nand2,高度5.04um 宽度1.98um 差不多面积10um2

陈涛 · 发表于 2011-9-26 12:08:30

以前比较确切地定义是4个transistor为一个gate，
计算整个设计的gate count时，应该先算出（所有standard cell的总面积），再除以（4个transistor的面积）。注意，各种RAM，PLL，ADC，DAC等macro不能算在总面积里

现在人们为了简单，就把一倍驱动能力的，2输入的nand cell的面积认为一个gate的面积，一个nand cell与4个transistor的面积是有一点差别的，但是你一般不容易搞到准确的4个transistor的面积

所以现在的standard cell的gate count就变成（所有standard cell的总面积），再除以（一倍驱动能力的，2输入的nand cell的面积）

前后端都应该用这个算法

qwerrewt · 发表于 2011-9-26 22:23:53

什么东西5000w门啊。。。

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