一个SystemVerilog和Debussy的问题

qiantianyiqian · 发表于 2011-6-25 15:05:54

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在SystemVerilog设计中，设计好了整个工程，其中包含program模块，也通过了questasim仿真，但是整个工程在Debussy打开的时候显示有一个Error，program模块没有定义。不知道有木有大侠遇到过这个问题，大家交流一下

sdwh606 · 发表于 2011-6-25 21:49:51

你的program模块添加到文件列表里了吗？

qiantianyiqian · 发表于 2011-6-27 16:52:18

回复 2# sdwh606

你是说“filelist”吗？所有有关的文件都加进去了啊。可是还是不行。
你有没有高招了？呵呵

dlb05061131 · 发表于 2012-10-30 15:17:52

回复 3# qiantianyiqian

请问你这个问题解决了么？

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