0.13um 工艺model /drc/lvs/pex file

Young_W · 发表于 2010-12-30 15:15:23

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The file are the (Design Rule, Electrical Parameter, DRC deck, Spice Model, Interconnect Model, LVS deck, Parasitic Extraction file) specifications (chrt)

0.13um_ANALOG_Generic_Dual_Gate_494.part1.rar (4.58 MB, 下载次数: 446 )

0.13um_ANALOG_Generic_Dual_Gate_494.part2.rar (4.58 MB, 下载次数: 402 )

0.13um_ANALOG_Generic_Dual_Gate_494.part3.rar (4.58 MB, 下载次数: 415 )

0.13um_ANALOG_Generic_Dual_Gate_494.part4.rar (4.58 MB, 下载次数: 415 )

0.13um_ANALOG_Generic_Dual_Gate_494.part5.rar (3.12 MB, 下载次数: 409 )

soochowren · 发表于 2010-12-30 20:07:38

好东西，做实验正需要

soochowren · 发表于 2010-12-30 20:14:06

可惜，解压错误

Daniel10003 · 发表于 2010-12-31 15:34:31

呵呵，谢谢楼主

qwe31 · 发表于 2010-12-31 16:16:07

多謝大大的指導

bmiwzmbmi · 发表于 2011-1-7 15:59:16

xiexie!

bmiwzmbmi · 发表于 2011-1-7 16:03:13

haode!

bmiwzmbmi · 发表于 2011-1-7 16:05:01

回复 6# bmiwzmbmi

haodE!

bmiwzmbmi · 发表于 2011-1-7 16:07:23

xiexie!

Young_W · 发表于 2011-3-10 17:18:22

回复 3# soochowren

压缩时分割了，全部下载后再解压就不会出错了！

[资料] 0.13um 工艺model /drc/lvs/pex file

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